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PE43601
Product Specification
Table 5. Control Voltage
Table 8. Address Word Truth Table
State
Low
Bias Condition
0 to +1.0 Vdc at 2 μ A (typ)
A7
(MSB)
A6
A5
Address Word
A4 A3
A2
A1
A0
Address
Setting
High
+2.6 to +5 Vdc at 10 μ A (typ)
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
L
L
L
L
L
L
H
H
L
H
L
H
000
001
010
011
Table 6. Latch and Clock Specifications
X
X
X
X
X
H
L
L
100
Latch Enable
X
↑
Shift Clock
↑
X
Function
Shift Register Clocked
Contents of shift register
transferred to attenuator core
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
H
H
H
L
H
H
H
L
H
101
110
111
Table 7. Parallel Truth Table
Table 9. Serial Attenuation Word Truth Table
D5
Parallel Control Setting
D4 D3 D2 D1
D0
Attenuation Setting
RF1-RF2
D7
D6
Attenuation Word
D5 D4 D3 D2
D1
D0
(LSB)
Attenuation
Setting
RF1-RF2
L
L
L
L
L
L
H
H
L
L
L
L
L
H
L
H
L
L
L
L
H
L
L
H
L
L
L
H
L
L
L
H
L
L
H
L
L
L
L
H
L
H
L
L
L
L
L
H
Reference I.L.
0.25 dB
0.5 dB
1 dB
2 dB
4 dB
8 dB
15.75 dB
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
L
H
H
L
L
L
L
L
H
L
H
L
L
L
L
H
L
L
H
L
L
L
H
L
L
L
H
L
L
H
L
L
L
L
H
L
H
L
L
L
L
L
H
Reference I.L.
0.25 dB
0.5 dB
1 dB
2 dB
4 dB
8 dB
15.75 dB
Table 10. Serial-Addressable Register Map
Bits can either be set to logic high or logic low
MSB (last in)
D6 and D7 must be set to logic low
LSB (first in)
Q15
A7
Q14
A6
Q13
A5
Q12
A4
Q11
A3
Q10
A2
Q9
A1
Q8
A0
Q7
D7
Q6
D6
Q5
D5
Q4
D4
Q3
D3
Q2
D2
Q1
D1
Q0
D0
Address Word
Attenuation Word
Attenuation Word is derived directly from the attenuation value. For example, to program the 12.75 dB state
at address 3:
Address Word: XXXXX011
Attenuation Word: Multiply by 4 and convert to binary → 4 * 12.75 dB → 51 → 00110011
Serial Input: XXXXX01100110011
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